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[主观题]

使用同步四位二进制同步计数器74LS163构成模8计数器.(1)计数状态中必须出现0000状态,设计其电路.(2)计数状态中不能出现0000状态和1111状态,设计其电路.(3)计数电路中除74LS163外只能使用一个非门,设计其电路.

使用同步四位二进制同步计数器74LS163构成模8计数器.(1)计数状态中必须出现0000状态,设计其电路.(2)计数状态中不能出现0000状态和1111状态,设计其电路.(3)计数电路中除74LS163外只能使用一个非门,设计其电路.

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第1题

试用1个4位二进制同步计数器构成一个余3码+进制同步计数器,即按照余3码规律计数,画出电路图和状态转换图。
试用1个4位二进制同步计数器构成一个余3码+进制同步计数器,即按照余3码规律计数,画出电路图和状态转换图。

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第2题

图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平
图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平

有效,使能端处于有效状态.

(1)74160构成多少进制计数器.

(2)假定74160初始状态Q3Q2Q1Q0=0000,试对应图5.28(b)的CP脉冲图画出Q3、Q2、Q1、Q0和Y的输出波形.

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第3题

使用同步二进制计数器74LS161及必要的门电路设计一个模100计数器.

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第4题

用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q 2Q1的状态. 转换关系如图
用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q2Q1的状态. 转换关系如图

用维持阻塞D触发器设计一个同步计数器,计数器的输出Q3Q2Q1的状态.

转换关系如图5-99所示。要求:

(1)列出状态表

(2)求出最简驱动方程;:

(3)西出逻辑电路图;

(4)检查能否自启动,如果不能自启动,修改电路。

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第5题

试用3个JK触发器(每个只有1个J瑞和1个K端)构成一个同步模5计数器,不得增加其他门电路,(提示:先构成有6个状态的相环形计数器,再设法去除一个状态)
试用3个JK触发器(每个只有1个J瑞和1个K端)构成一个同步模5计数器,不得增加其他门电路,(提示:先构成有6个状态的相环形计数器,再设法去除一个状态)

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第6题

试用3个JK触发器(每个只有1个J瑞和1个K端)构成一个同步模5计数器,不得增加其他门电路,(提示:先构成有6个状态的相环形计数器,再设法去除一个状态)

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第7题

分析图10.95(a)所示电路.(1)画出CT74161(4位二进制加法计数器)Q3Q2Q1Q0的状态
分析图10.95(a)所示电路.(1)画出CT74161(4位二进制加法计数器)Q3Q2Q1Q0的状态

转换图.假设Q3Q2Q1Q0的初始状态均为0,说明CT74161构成几进制计数器.

(2)说明C174138电路实现的功能.

(3)写出图10.95(a)完成的电路功能符合ABEL语言(GAL16V8如图10.95(b)所示)或VHDL语言的用户原文件(可省略测试向量段).

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第8题

用4位二进制同步可逆计数器T4193和必要的逻辑门实现模12加法计数器。

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第9题

图10.66所示为四位二进制加法计数器,其功能表见表10.16所示.试将两片CT74161采用同步级联方式
及总体反馈归零法设计成一个23进制计数器,要求写出设计过程并画出连接图.

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第10题

试用两片4位二进制同步加法计数器CT74161及少量门电路构成100进制计数器.

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